JP2023053858A 审中 非冯诺依曼电路
为数字输入部分的输入值的组合统一决定数字输出值的电路,允许第三方确认要与数字输入值进行比较的数字数据值和电路的配置以提供非冯·诺依曼型电路,可以创建和设置创建电路。 一种能够创建和设置电路的电路包括输入部分(1)旁边的输入选择电路(3)和与输入进行比较的比较值创建电路部分(4)。接下来是异或电路部分(5),然后是OR电路组合电路部分(6),接下来是NOT电路部分(7),再接下来是OR电路组合电路,用于输出。还有(8)部分,然后有一个带有输出部分 (2) 的电路。
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专利时间轴
  • 01 Oct 2021 申请日
    JP/2021176956
    优先权
  • 01 Oct 2021 申请日
    JP/2023053858
    当前专利 申请号
  • 13 Apr 2023 公开(公告)日期
    JP2023053858A
    申请号
专利类型/受理局 APPLICATION( JP)
[标]当前申请(专利权)人 尊田 浩二
当前申请(专利权)人 尊田 浩二

福岡県福岡市西区横浜二丁目7番地の3 407号

[标]原始申请(专利权)人 尊田 浩二
原始申请(专利权)人 尊田 浩二

福岡県福岡市西区横浜二丁目7番地の3 407号

IPC分类号
IPC(8): G06F7/575G06F7/57H03K19/17724 +3
技术主题分类
应用领域分类
发明人

尊田 浩二 (福岡県福岡市西区横浜二丁目7番地の3 407号)

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